从头开始使用 Verilog HDL 构建处理器—Building a Processor with Verilog HDL from Scratch

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从头开始使用 Verilog HDL 构建处理器

Building a Processor with Verilog HDL from Scratch

使用赛灵思 Vivado 2020.2

你将学到什么

• 实现基于Verilog的CPU的策略
• 建立自定义指令集以满足资源利用率
• 在处理器内添加程序和数据存储器的策略
• 在处理器内添加跳转和分支指令的策略

要求

• 数字电子基础知识

描述

大多数 21 世纪的应用都需要强大的硬件，同时还需要允许开发复杂算法的集中控制器。随着我们进入人工智能或基于云的设备，并且系统复杂性每天都在增长，随着我们在人工智能时代的进步，合并多个处理器实例的需求变得强制性。Zynq 和 Microblaze 是市场上存在的两种流行的替代方案，几乎可以满足任何应用需求。使用处理器的多个实例的要求即。为了独立处理数据处理和控制要求，需要使用多个 Microblaze 软处理器实例或使用 Zynq 处理器等硬处理器以及单个或多个 Microblazer 实例。合并 Microblaze 等软处理器的多个实例的根本挑战是在 FPGA 上实现 Microblaze 所消耗的资源数量。由于 FPGA 由有限数量的 FPGA 资源组成，因此硬件和软件分区在构建复杂系统中发挥着重要作用。嵌入式工程师采用的另一种流行的替代方法是构建具有唯一所需功能的定制 CPU/处理器，从而与添加 Microblaze 实例相比节省大量资源。本课程将讨论使用 Verilog HDL 构建简单处理器/CPU 所需的所有基础知识以及测试其功能的策略。完成本课程后，您将了解构建复杂 CPU 架构以满足要求所需的所有必要技能。祝愿您能够打造自己的处理器。

本课程适合谁：

• 任何有兴趣在 FPGA 上构建定制 CPU 以实现负载共享的人